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Nouvelles architectures d'interfaçage graphique dans les systèmes à microprocesseur / Maamoun, Mountassar 

Public ISBD Titre : Nouvelles architectures d'interfaçage graphique dans les systèmes à microprocesseur Type de document : texte imprimé Auteurs : Maamoun, Mountassar, Auteur ; Berkani, Daoud, Directeur de thèse Editeur : [S.l.] : [s.n.] Année de publication : 2007 Importance : 124 f. Présentation : ill. Format : 30 cm. Accompagnement : 1 CD-ROM. Note générale : Thèse de Doctorat : Électronique : Alger, École Nationale Polytechnique : 2007 Bibliogr. f. 120 - 124 . Annexe [9] f Langues : Français (fre) Mots-clés : Interfaçage  graphique Systèmes  à  microprocesseur Traitement  d’images  en  temps  réel Système  logiciel/matériel Index. décimale : D000507 Résumé : Cette thèse présente une contribution à l’interfaçage graphique dans les systèmes à microprocesseur. Nous nous sommes posé comme objectif de concevoir de nouveaux systèmes d’adressage physique et de développer de nouveaux principes de reproduction vidéo. Dans le contexte de l’interfaçage nous avons développé l’Adressage Physique Etendu, l’Adressage Physique Accéléré, l’Adressage Physique Rapide et l’Adressage Physique Avancé. Pour le principe de la reproduction d’images, nous avons élaboré une nouvelle architecture de reconstruction d’images basée sur la décomposition physique de la mémoire vidéo pour assurer un accès simultané de lecture/écriture. Les systèmes proposés sont réalisables avec la logique programmable et constituent une solution pour les systèmes d’affichages avec un traitement d’images en temps réel. Une partie des travaux réalisés est référenciée dans le brevet « DIGITAL IMAGE TRANSFER CONTROLLER ». Le brevet est exploité par Sony® et enregistré dans U.S Patent le 20 septembre 2005. Cette thèse est répartie en quatre chapitres: Le premier chapitre est consacré à la présentation de l’état de l’art des interfaces d'entrées sorties et le fonctionnement général des bus actuels. Le deuxième chapitre expose nos quatre nouvelles techniques d’interfaçages dans les systèmes à microprocesseur: l’Adressage Physique Etendu, l’Adressage Physique Accéléré, l’Adressage Physique Rapide et l’Adressage Physique Avancé. Dans le troisième chapitre nous exposons une revue des principaux types de circuits intégrés programmables et reprogrammables, allant de la simple mémoire programmable au circuit FPGA (Field Programmable Gate Array). Ensuite nous présentons l’implémentation et le test de nos techniques d’interfaçage sur des cibles de la logique programmable en utilisant des solutions schématiques et VHDL. Le quatrième chapitre présente les nouvelles techniques de production d’image basées sur les nouveaux systèmes d’interfaçages ainsi que les techniques d’affichage admettant un accès simultané de lecture/écriture sur la RAM vidéo. La thèse se termine par une conclusion générale où nous commentons le travail effectué et nous proposons des améliorations et perspectives. Nouvelles architectures d'interfaçage graphique dans les systèmes à microprocesseur [texte imprimé] / Maamoun, Mountassar, Auteur ; Berkani, Daoud, Directeur de thèse . - [S.l.] : [s.n.], 2007 . - 124 f. : ill. ; 30 cm. + 1 CD-ROM. Thèse de Doctorat : Électronique : Alger, École Nationale Polytechnique : 2007 Bibliogr. f. 120 - 124 . Annexe [9] f Langues : Français (fre) Mots-clés : Interfaçage  graphique Systèmes  à  microprocesseur Traitement  d’images  en  temps  réel Système  logiciel/matériel Index. décimale : D000507 Résumé : Cette thèse présente une contribution à l’interfaçage graphique dans les systèmes à microprocesseur. Nous nous sommes posé comme objectif de concevoir de nouveaux systèmes d’adressage physique et de développer de nouveaux principes de reproduction vidéo. Dans le contexte de l’interfaçage nous avons développé l’Adressage Physique Etendu, l’Adressage Physique Accéléré, l’Adressage Physique Rapide et l’Adressage Physique Avancé. Pour le principe de la reproduction d’images, nous avons élaboré une nouvelle architecture de reconstruction d’images basée sur la décomposition physique de la mémoire vidéo pour assurer un accès simultané de lecture/écriture. Les systèmes proposés sont réalisables avec la logique programmable et constituent une solution pour les systèmes d’affichages avec un traitement d’images en temps réel. Une partie des travaux réalisés est référenciée dans le brevet « DIGITAL IMAGE TRANSFER CONTROLLER ». Le brevet est exploité par Sony® et enregistré dans U.S Patent le 20 septembre 2005. Cette thèse est répartie en quatre chapitres: Le premier chapitre est consacré à la présentation de l’état de l’art des interfaces d'entrées sorties et le fonctionnement général des bus actuels. Le deuxième chapitre expose nos quatre nouvelles techniques d’interfaçages dans les systèmes à microprocesseur: l’Adressage Physique Etendu, l’Adressage Physique Accéléré, l’Adressage Physique Rapide et l’Adressage Physique Avancé. Dans le troisième chapitre nous exposons une revue des principaux types de circuits intégrés programmables et reprogrammables, allant de la simple mémoire programmable au circuit FPGA (Field Programmable Gate Array). Ensuite nous présentons l’implémentation et le test de nos techniques d’interfaçage sur des cibles de la logique programmable en utilisant des solutions schématiques et VHDL. Le quatrième chapitre présente les nouvelles techniques de production d’image basées sur les nouveaux systèmes d’interfaçages ainsi que les techniques d’affichage admettant un accès simultané de lecture/écriture sur la RAM vidéo. La thèse se termine par une conclusion générale où nous commentons le travail effectué et nous proposons des améliorations et perspectives.

Exemplaires

Code-barres	Cote	Support	Localisation	Section	Disponibilité	Spécialité	Etat_Exemplaire
D000507B	D000507	Papier + ressource électronique	Bibliothèque Annexe	Thèse de Doctorat	Disponible	Electronique	Consultation sur place/Téléchargeable
D000507A	D000507	Papier + ressource électronique	Bibliothèque centrale	Thèse de Doctorat	Disponible	Electronique	Consultation sur place/Téléchargeable

Documents numériques

MAAMOUN.Mountassar.pdf URL