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Auteur Meraghni, A.
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Affiner la rechercheEtude et réalisation d'un programme d'analyse transitoire des circuits intégrés à M.O.S.: P.A.T.M.O.S. / Touhami Née Mahdi, Rachida
Titre : Etude et réalisation d'un programme d'analyse transitoire des circuits intégrés à M.O.S.: P.A.T.M.O.S. Type de document : texte imprimé Auteurs : Touhami Née Mahdi, Rachida, Auteur ; Meraghni, A., Directeur de thèse Editeur : [S.l.] : [s.n.] Année de publication : 1989 Importance : 113 f. Présentation : ill. Format : 30 cm Note générale : Mémoire de Magister: Electronique: Alger, Ecole Nationale Polytechnique: 1989
Annexe f. 114-117. Bibliogr. f. 118-120Langues : Français (fre) Mots-clés : Programme d'analyse transitoire; Circuits intégrés à M.O.S; Modélisation du transistor; MOS Programme; PATMOS Index. décimale : M000489 Résumé :
Ceci nous mène à établir notre plan de travail comme suit:
Dans un premier chapitre; nous présenterons la conception du modèle numérique du transistor M.O.S qui comprend deux approximations (transistor simple, transistor avec Cgs et Cgd) ainsi qu'une étude sur les modèles mathématiques et physiques.
Au deuxième chapitre, le choix de l'algorithme d'analyse résulte d'un compromis entre la convergence, le temps de calcul et l'espace mémoire.
Nous étudierons principalement les méthodes d'analyse, de formulation et d'intégration pour l'élaboration d'un programme universel avec temps de réponse et espace mémoire optimaux.
Au troisième chapitre; les méthodes de formulation des équations par la théorie des graphes et la variable d'état, présentent des contraintes pour l'élaboration d'un logiciel universel.
Nous avons jugé utile d'élaborer un algorithme de formulation automatique des équations d'analyse pour le transistor M.O.S. simple, le transistor avec capacité entre électrodes.
Une étude numérique sur les méthodes de résolution des équations linéaires nous a permis l'amélioration de ce programme.
Au quatrième chapitre; l'optimisation a été faite à partir:
- De l'élaboration des logiciels de conversion topologie / données de description.
- Du choix d'un calcul automatique du pas d'intégration, permettant de diminuer le temps d'exécution du PATMOS.
Les vérifications expérimentales nous ont permis d'évaluer la précision avec laquelle le circuit intégré est simulé.Etude et réalisation d'un programme d'analyse transitoire des circuits intégrés à M.O.S.: P.A.T.M.O.S. [texte imprimé] / Touhami Née Mahdi, Rachida, Auteur ; Meraghni, A., Directeur de thèse . - [S.l.] : [s.n.], 1989 . - 113 f. : ill. ; 30 cm.
Mémoire de Magister: Electronique: Alger, Ecole Nationale Polytechnique: 1989
Annexe f. 114-117. Bibliogr. f. 118-120
Langues : Français (fre)
Mots-clés : Programme d'analyse transitoire; Circuits intégrés à M.O.S; Modélisation du transistor; MOS Programme; PATMOS Index. décimale : M000489 Résumé :
Ceci nous mène à établir notre plan de travail comme suit:
Dans un premier chapitre; nous présenterons la conception du modèle numérique du transistor M.O.S qui comprend deux approximations (transistor simple, transistor avec Cgs et Cgd) ainsi qu'une étude sur les modèles mathématiques et physiques.
Au deuxième chapitre, le choix de l'algorithme d'analyse résulte d'un compromis entre la convergence, le temps de calcul et l'espace mémoire.
Nous étudierons principalement les méthodes d'analyse, de formulation et d'intégration pour l'élaboration d'un programme universel avec temps de réponse et espace mémoire optimaux.
Au troisième chapitre; les méthodes de formulation des équations par la théorie des graphes et la variable d'état, présentent des contraintes pour l'élaboration d'un logiciel universel.
Nous avons jugé utile d'élaborer un algorithme de formulation automatique des équations d'analyse pour le transistor M.O.S. simple, le transistor avec capacité entre électrodes.
Une étude numérique sur les méthodes de résolution des équations linéaires nous a permis l'amélioration de ce programme.
Au quatrième chapitre; l'optimisation a été faite à partir:
- De l'élaboration des logiciels de conversion topologie / données de description.
- Du choix d'un calcul automatique du pas d'intégration, permettant de diminuer le temps d'exécution du PATMOS.
Les vérifications expérimentales nous ont permis d'évaluer la précision avec laquelle le circuit intégré est simulé.Exemplaires
Code-barres Cote Support Localisation Section Disponibilité Spécialité Etat_Exemplaire M000489 M000489 Papier Bibliothèque centrale Mémoire de Magister Disponible Documents numériques
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